cadence virtuoso

新一代Virtuoso 模拟设计环境(ADE)，助力工程师探索、分析并验证是否达到设计目标，确保周期内设计目标的一致性。本站为大家整理的相关的，供大家参考选择。

　　cadence virtuoso

 

　　virtuoso是电子电路仿真设计必备的软件。而且在linux系统系运行的，很多操作都要用命令来进行操作。本教程将以Virtuoso6.1.4-64b为例讲一下基本操作。

　　工具/原料

　　电脑

　　虚拟机

　　已安装好的Cadence virtuoso软件

　　方法/步骤

　　1在自己的目录下新建一个文件夹来存放自己的例程。

　　使用命令：mkdir test/

　　可以用：ls 来查看是否新建成功

　　2建好后，进入刚刚建立好的文件夹里

　　使用：cd test/

　　3接着启动 Cadence virtuoso

　　使用：virtuoso

　　(前提这个电脑的Linux要安装好Cadence virtuoso，具体可以百度)

　　4打开Cadence virtuoso之后，开始点击File-->New-->Library,写上库的名字，比如test，接着会让你选择工艺库，根据你自己要用的选择即可。比如我选择了TSMC65N。

　　5接着点击File-->New-->Cellview，写上Cell的名字，比如test。

　　6按字母“i”放置元件，比如搭建一个反相器，这里选择pch，nch。w键是连线，p是放置pin的快捷键，vdc是电压源。

　　7搭建完成以后，按照图示进行。先check和save一下，再launch-->ADEL.

　　8选择 工艺角:setup-->model libraries,添加自己需要的工艺角即可

　　9选择仿真观测信号：output-->to be ploted -->selected on schematic

　　10信号的输入：setup-->stimuli...-->

　　11选择仿真类型：analyse-->choose-->tran

　　时间选择1s

　　12点击绿色的run即可运行仿真

　　13得到结果，可以使用红色标注的地方放大波形，到此电路波形仿真结束

　　cadence virtuoso

　　内容提要：

　　新一代Virtuoso 模拟设计环境(ADE)，助力工程师探索、分析并验证是否达到设计目标，确保周期内设计目标的一致性

　　Virtuoso版图工具在大型芯片版图设计中的缩放、平移及图形生成方面的性能提速达 100 倍之多

　　2016年4月13日，中国上海 —— 楷登电子(美国 Cadence 公司，NASDAQ:CDNS)今日发布新一代Virtuoso® 设计平台，可以为设计师实现平均达10倍的全平台性能和容量的提升。该平台包括采用多项新技术的Cadence® Virtuoso 模拟设计环境(ADE)工具，和进一步提高性能的CadenceVirtuoso 版图工具， 来全面地应对汽车安全、医疗器械及物联网(IoT)应用的需求。

　　如需了解关于Virtuoso ADE产品套件的更多信息，请访问www.cadence.com/news/virtuosoade。如需了解关于Virtuoso版图套件的更多信息，请访问www.cadence.com/news/virtuosols。

　　新一代Virtuoso ADE产品套件

　　自1991年伊始，Virtuoso® 技术与工具平台就已在定制化IC和模拟设计的前端中被广泛采用，25年中，Virtuoso平台帮助无以数计的工程师和IC设计制造商将创新的设计在产品中实现并投放市场。现在，不断涌现的全新行业标准、先进工艺节点设计及更高的系统设计要求带来了一系列挑战，新一代Cadence Virtuoso ADE 产品套件应运而生，助力工程师充分探索、分析并验证其设计，确保全周期内设计目标的一致性。数据处理能力的增强表现在加载数据库超过 1 GB 的波形文件时速度最快可提高 20 倍;同时其版本管理和设置文件的加载性能最高可提升 50 倍。套件的关键技术包括：

　　Virtuoso ADE探索工具(VirtuosoADE Explorer)：快速、精确的实现设计参数实时调节;自动生成合格/不合格设计的数据列表;提供了完整的工艺角及蒙特卡罗随机抽样统计环境用于检测并修复工艺随机变化问题

　　Virtuoso ADE 组装工具(Virtuoso ADE Assembler)：助力工程师分析不同工艺-电压-温度(PVT)参数组合下的设计性能，并提供基于图形用户界面(GUI)的验证方案，帮助设计师更方便的进行条件性和相关性的仿真

　　Virtuoso ADE验证工具(Virtuoso ADE Verifier)：模拟验证技术的重大进步。集成仪表板可帮助工程师轻松进行设计验证，确保全部模块都符合整体设计规范

　　“全新Virtuoso ADE验证工具技术与Virtuoso ADE组装工具技术具备设计规划能力，让设计团队更加高效”，华为海思图灵处理器业务部副总经理刁焱秋说，“我们是全新CadenceVirtuoso ADE产品套件的早期客户之一，这一套件帮助我们将模拟IP验证效率提升了近30%，验证发现的问题数量减少了一半。套件的全新功能将令我们的智能手机和网络芯片项目获益匪浅。”

　　Virtuoso版图工具性能提升

　　增强的Virtuoso 版图套件通过加速性能和效率来应对复杂版图带来的挑战，用于器件、单元、模块及芯片级的全定制模拟、数字与混合信号设计。最新版本在以下功能得到增强：

　　图形渲染性能：大版图上缩放、平移、及图形显示的速度可提高 10 -100 倍

　　模块生成器(ModGen)：采用交互式图形处理流程，ModGens 的实时定制更为直观、简单;新版本的模块生成器现在还支持设计单元的同步克隆，产生的版图单元具有相同的物理特性，如晶体管的长度和宽度。这样的话，版图设计师只需要设计一次并重复使用。

　　创新结构化器件级布线：结构化的器件级布线功能可实现最高 50 % 的布线效率提升

　　“25年以来，客户一直都非常信任CadenceVirtuoso平台，基于该平台每年有数以千计的设计流片，”Cadence 全定制IC与 PCB 部门高级副总裁兼总经理 Tom Beckley 表示。“目前，业内对全定制设计的需求空前强烈，很多设计愈加复杂，我们要进一步简化设计过程，从而帮助客户满足进度要求，按时完成设计。新一代Virtuoso平台的推出使高速、精确的全定制设计成为可能，再次证实了 Cadence 在全定制设计前沿领域的创新能力。”

　　关于Cadence

　　Cadence 公司致力于推动全球电子设计创新，在开创集成电路和电子产品中发挥着核心作用。客户采用Cadence 的软件、硬件、IP 和服务，设计并验证尖端半导体器件、消费电子产品、网络架构和通讯设备以及计算机系统。Cadence公司总部位于美国加州圣荷塞市，在世界各地均设有销售办事处、设计中心和研究机构，为全球电子产业提供服务。如需了解关于Cadence 公司、产品及服务的更多信息，请访问公司网站http://www.cadence.com。

　　cadence virtuoso

　　内容提要：

　　○ 高阶布局方法和仿真驱动布线将提升生产力高达 50%

　　○ FinFET 布局工作量减少 3 倍以上

　　○ Virtuoso ADE 仿真吞吐量提升高达3 倍

　　○ 先进统计算法将工艺参量变化对设计影响分析的时间减少约 20%

　　○ Virtuoso ADE Verifer通过和工业界验证标准结合将验证效率提升30%

　　○ 增强版Virtuoso System Design 系统设计平台，能够同时支持多种工艺和多种PDK

　　中国上海，2018 年 4 月 11 日 – 楷登电子(美国 Cadence 公司，NASDAQ: CDNS)今日正式发布 Cadence® Virtuoso® 定制 IC 设计平台的技术升级和扩展，进一步提高电子系统和 IC 设计的生产力。新技术涉及 Virtuoso 系列几乎所有产品，旨在为系统工程师提供更稳健的设计环境和生态系统，助其实现并分析复杂芯片、封装、电路板和系统。

　　如需了解全新 Virtuoso 平台的详细内容，请参阅https://www.cadence.com/go/virtuoso-whats-new.html

　　增强版 Virtuoso 系统设计平台

　　Virtuoso 平台 2018全新内容中，最重要的是去年发布且荣获奖项的 Virtuoso System Design Platform，基于全面升级和扩展的Virtuoso 系统设计平台,设计师可以无缝编辑并分析最复杂的异构系统。封装、光电、IC 模拟与 RF 工程师皆可在同一个平台上操作并充分使用 Virtuoso平台深具信任的完整设计应用。

　　新系统设计环境的核心是集合了多项新技术允许设计师在同一平台下对不同工艺不同技术的设计进行同步编辑。同时该系统设计平台与 Cadence SIP Layout方案以及Sigrity™ 分析技术实现无缝互联，为设计师提供完整的“芯片至电路板”设计工具。

　　Virtuoso 高阶节点设计与布局

　　全新发布的 Virtuoso 平台中，Cadence 采用了创新的高阶节点技术，实现从 22nm 到 5nm所有工艺的设计加速。通过与领先代工厂、生态系统合作伙伴及客户的紧密合作，Cadence研发出可以利用创新方法自动管理工艺复杂度的先进技术，帮助设计师更加专注于设计目标。在电路设计和分析方面，针对 FinFET 设计开发的先进统计算法可以在设计早期发现工艺参量变化引起的电路性能波动，将工艺参量变化对设计影响的分析时间减少约 20%。

　　布局设计方面，一种独特的多网格系统可以提取最新 7nm 和 5nm 工艺的复杂设计规则，同时允许设计师增加布局和布线技术的使用，大幅提升布局设计的生产力。在 7nm 节点下，上述优化可将布局工作量减少 3 倍以上。

　　Virtuoso 先进设计方法学与自动化

　　Cadence 研发了多项提升模拟设计和分析的技术。通过与 Cadence Spectre® 电路仿真器集成，并采用先进分析技术减少设计迭代，Virtuoso 模拟设计环境(ADE)的仿真吞吐量提升高达 3 倍。Virtuoso ADE Verifier也加入了专属新功能，汇集了跨领域电气规范，使实现标准合规(ISO 26262 等标准)的难度降低了约 30%。

　　凭借保障电路完整性和性能的一系列专属设计技术，Virtuoso 布局环境正从“电气感知布局”进化为业界首个“电气和仿真驱动”的布局方式。全新仿真驱动布局可以解决关键电路和高阶节点设计中的许多电迁移(EM)和寄生问题。为了提高布局的自动化水平，新环境加入了多项针对层次化版图规划的突破性技术，以及全新的布局和布线自动化技术，大幅提高布局设计生产力，并缩短布局时间。

　　鉴于当今芯片的复杂程度愈演愈烈，其中一个很大的设计难题是如何将布局任务在设计团队间进行合理分配。增强版 Virtuoso 平台加入了创新的并行实时团队设计编辑功能，允许团队对布局任务进行分配并探索各种假设情形。这一功能对设计规则检查(DRC)的修改、芯片完成和人工布线都十分有用。

　　Cadence 预计，电气驱动布线和走线编辑、实时设计编辑与革命性设计规划技术的全新布局环境可以将生产力提升达 50%。

　　“在Bosch，当我们设计关键任务的系统时，可靠性是我们的第一考量。我们对 EDA 工具的要求是，其不仅能帮助我们的工程师高效地设计、分析、布排电路，达到可靠性标准，而且还不能拖累项目的整体生产力，”Bosch公司 EDA 高级项目经理 Göran Jerke 表示。“通过与 Cadence 的长期合作，我们在过去的电气感知布局和最新的电气驱动布局方面都取得了宝贵成果。”

　　“我们的目标是向客户提供最完整的解决方案，通过贯通芯片、封装、模组和电路板等各设计领域的无缝互联流程，帮助客户更好地设计并验证包括模拟、混合信号、RF和光电产品在内的各种异构系统，” Cadence 公司资深副总裁兼定制 IC 和 PCB 事业部总经理Tom Beckley 表示。“全新 Virtuoso 平台是在大获成功的 Virtuoso 电气感知设计布局套件基础之上开发而成的，它突破性的分析功能与电气驱动布局功能可以提升设计实现的可靠性。此外，它还能支持包括 5nm 节点在内的最先进工艺技术。通过与领先代工厂、生态系统合作伙伴和客户展开合作，我们成功实现了定制和仿真设计方法学的大幅增强。”

　　关于楷登电子 Cadence

　　Cadence 公司致力于推动电子系统和半导体公司设计创新的终端产品，以改变人们的工作、生活和娱乐方式。客户采用 Cadence的软件、硬件、IP 和服务，覆盖从半导体芯片到电路板设计乃至整个系统，帮助他们能更快速向市场交付产品。Cadence 公司创新的“系统设计实现” (SDE)战略，将帮助客户开发出更具差异化的产品，无论是在移动设备、消费电子、云计算、汽车电子、航空、物联网、工业应用等其他的应用市场。Cadence 公司同时被财富杂志评选为“全球年度最适宜工作的100家公司”之一。了解更多，请访问公司网站 www.cadence.com。

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